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[[Datei:Transmeta efficeon Logo.svg|miniatur|Logo]]

Der unter dem Codenamen ''Astro'' entwickelte '''Efficeon''' ist eine besonders stromsparende [[Prozessor]]-Familie der Firma [[Transmeta]], die vor allem für [[eingebettetes System|eingebettete Systeme]], [[Notebook]]s sowie geräuscharme [[Arbeitsplatzrechner]], bei denen auf eine aktive Kühlung verzichtet wird, eingesetzt werden sollte.

Der 256-Bit-Prozessor setzt wie sein Vorgänger [[Transmeta Crusoe|Crusoe]] auf die [[Code-Morphing]]-Technik und die [[Very Long Instruction Word|VLIW]]-Architektur. Die Effizienz des Code-Morphing wurde jedoch deutlich verbessert. Bisher emuliert diese Technik die [[x86-Prozessor]]-Architektur inklusive [[Intel]]s [[Streaming SIMD Extensions 2|SSE2]]-Befehlssatzerweiterung. Theoretisch könnten jedoch auch andere Architekturen emuliert werden.

== Modelldaten ==
=== TM8300 ===
* L1-Cache: 64 + 128 KB (Daten + Instruktionen)
* L2-Cache: 512 KB mit Prozessortakt
* [[Multi Media Extension|MMX]], [[Streaming SIMD Extensions|SSE]], [[Streaming SIMD Extensions 2|SSE2]], [[LongRun]]!2
* [[Very Long Instruction Word|VLIW]] mit Code-Morphing-Technik
* [[Northbridge]] in CPU integriert
* Packaging:
** 783 Pin BGA
* Erscheinungsdatum: Juni 2004
* Fertigungstechnik: 130 nm bei [[TSMC]]
* [[Die (Halbleitertechnik)|Die]]-Größe: 119 mm² bei einer unbekannten Anzahl [[Transistor]]en
* Taktraten: 1000 und 1100 MHz

=== TM8500 ===
* L1-Cache: 64 + 128 KB (Daten + Instruktionen)
* L2-Cache: 512 KB mit Prozessortakt
* [[Multi Media Extension|MMX]], [[Streaming SIMD Extensions|SSE]], [[Streaming SIMD Extensions 2|SSE2]], [[LongRun]]!2, [[NX-Bit]]
* [[Very Long Instruction Word|VLIW]] mit Code-Morphing-Technik
* [[Northbridge]] in CPU integriert
* Packaging:
** 783 Pin BGA
* Erscheinungsdatum:
* Fertigungstechnik: 90 nm bei [[Fujitsu]]
* [[Die (Halbleitertechnik)|Die]]-Größe: 68 mm² bei einer unbekannten Anzahl [[Transistor]]en
* Taktraten: 1000–1700 MHz

=== TM8600/TM8620 ===
[[Datei:KL Transmeta Efficeon 8600.jpg|miniatur|hochkant|Transmeta Efficeon TM8600]]
* L1-Cache: 64 + 128 KB (Daten + Instruktionen)
* L2-Cache: 1.024 KB mit Prozessortakt
* [[Multi Media Extension|MMX]], [[Streaming SIMD Extensions|SSE]], [[Streaming SIMD Extensions 2|SSE2]], [[LongRun]]!2
* [[Very Long Instruction Word|VLIW]] mit Code-Morphing-Technik
* [[Northbridge]] in CPU integriert
* Packaging:
** 783 Pin BGA (TM8600)
** 592 Pin BGA (TM8620)
* Erscheinungsdatum: Juni 2004
* Fertigungstechnik: 130 nm bei [[TSMC]]
* [[Die (Halbleitertechnik)|Die]]-Größe: 119 mm² bei einer unbekannten Anzahl [[Transistor]]en
* Taktraten: 1000–1200 MHz

=== TM8800/TM8820 ===
[[Datei:KL Transmeta Efficeon 2 8820.jpg|miniatur|hochkant|Transmeta Efficeon 2 TM8820]]
* L1-Cache: 64 + 128 KB (Daten + Instruktionen)
* L2-Cache: 1.024 KB mit Prozessortakt
* [[Multi Media Extension|MMX]], [[Streaming SIMD Extensions|SSE]], [[Streaming SIMD Extensions 2|SSE2]], [[Streaming SIMD Extensions 3|SSE3]], [[LongRun]]!2, [[NX-Bit]]
* [[Very Long Instruction Word|VLIW]] mit Code-Morphing-Technik
* [[Northbridge]] in CPU integriert
* Packaging:
** 783 Pin BGA (TM8800)
** 592 Pin BGA (TM8820)
* Erscheinungsdatum: September 2004
* Fertigungstechnik: 90 nm bei [[Fujitsu]]
* [[Die (Halbleitertechnik)|Die]]-Größe: 68 mm² bei einer unbekannten Anzahl [[Transistor]]en
* Taktraten: 1000–1700 MHz

== Weblinks ==
*[http://www.tecchannel.de/pc_mobile/notebook/402196/alle_details_zum_transmeta_efficeon/ Alle Details zum Transmeta Efficeon]

[[Kategorie:Mikroprozessor]]

Transmeta Efficeon - Versionsgeschichte

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