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	<title>Known Good Die - Versionsgeschichte</title>
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	<updated>2026-06-02T00:33:47Z</updated>
	<subtitle>Versionsgeschichte dieser Seite in Wikipedia (Deutsch) – Lokale Kopie</subtitle>
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		<id>https://wiki-de.moshellshocker.dns64.de/index.php?title=Known_Good_Die&amp;diff=1443371&amp;oldid=prev</id>
		<title>93.194.10.89: Es wurden Kleinigkeiten wie Satzzeichen sowie Fehlendes ergänzt.</title>
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		<updated>2022-06-25T20:20:40Z</updated>

		<summary type="html">&lt;p&gt;Es wurden Kleinigkeiten wie Satzzeichen sowie Fehlendes ergänzt.&lt;/p&gt;
&lt;p&gt;&lt;b&gt;Neue Seite&lt;/b&gt;&lt;/p&gt;&lt;div&gt;Ein &amp;#039;&amp;#039;&amp;#039;{{lang|en|Known Good Die}}&amp;#039;&amp;#039;&amp;#039; (Abkürzung: KGD; englisch für ‚erwiesenermaßen fehlerfreier Chip‘) bezeichnet in der [[Mikroelektronik]] einen [[Integrierter Schaltkreis|Integrierten Schaltkreis]] (genauer einen [[Die (Halbleitertechnik)|Die]]), der bereits vor seinem Einbau in ein [[Chipgehäuse]] durch Tests als fehlerfrei qualifiziert wurde.&lt;br /&gt;
&lt;br /&gt;
Im üblichen Herstellungsprozess erfolgt der Test des Chips erst nach der Verpackung in ein Gehäuse (Gehäusung), da dies mechanisch und elektrisch einfacher realisierbar ist und damit auch die Fehler erkannt werden, die bei der Verpackung entstehen können. Mit der vertikalen Integration mehrerer Chips in einem Gehäuse ([[System-in-Package]]) wurde es jedoch ökonomisch notwendig, die Fehlerfreiheit des Chips vor der Montage festzustellen. Dies wird erreicht, indem Testinhalte, die sonst im abschließenden Funktionstest stattfinden, in den [[Wafertest]] übernommen werden.&lt;br /&gt;
&lt;br /&gt;
&amp;#039;&amp;#039;Known Good Dies&amp;#039;&amp;#039; werden bislang hauptsächlich für die Verwendung in System-in-Package hergestellt, da im Vergleich zum konventionellen Vorgehen die Kosten höher sind und nicht die gleichen Fehlerfreiheitsraten erreicht werden können.&lt;br /&gt;
Trotzdem wird die Technik immer häufiger eingesetzt, um Chips vor der Auslieferung zu testen, wenn der nachfolgende Fertigungsschritt bei Fehlerhaftigkeit die Kosten rechtfertigt, wie in komplexeren [[Chip-On-Board-Technologie|Chip-on-Board]]-Aufbauten.&lt;br /&gt;
&lt;br /&gt;
== Literatur ==&lt;br /&gt;
* {{Literatur |Autor=William J. Greig |Titel=Integrated circuit packaging, assembly and interconnections |Verlag=Springer |Datum=2007 |ISBN=978-0-387-28153-7 |Kapitel=Kapitel 6: Known Good Die (KGD) |Seiten=81–93}}&lt;br /&gt;
&lt;br /&gt;
[[Kategorie:Mikroelektronik]]&lt;br /&gt;
[[Kategorie:Halbleitertechnik]]&lt;br /&gt;
[[Kategorie:Aufbau- und Verbindungstechnik der Elektronik]]&lt;/div&gt;</summary>
		<author><name>93.194.10.89</name></author>
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